Equivalence Checker For Netlists

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ORCAD の模式設計の 2 つのネットリストの等価性チェック。2 つのネットリストが、異なるパーツ参照とシガネル名を持つ異なる設計手順から派生した場合でも、後の設計段階でアイドエンド PCB を生成できるかどうかを確認します。

バージョン履歴

  • バージョン beta_uncompleted に転記 2007-10-25
    いくつかの修正と更新
  • バージョン N/A に転記 2007-10-25

プログラムの詳細